drive circuit. STF16360EN Datasheet

STF16360EN circuit. Datasheet pdf. Equivalent

STF16360EN Datasheet
Recommendation STF16360EN Datasheet
Part STF16360EN
Description Static VFD drive circuit
Feature STF16360EN; STF16360EN VFD STF16360EN VFD 36 VFD 36 / 36 CPU CPU VFD +5V GND 0V Ve.
Manufacture ETC
Datasheet
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ETC STF16360EN
STF16360EN
静态 VFD 驱动电路
概述
STF16360EN是一种静态 VFD 驱动电路 带有 36 位高压驱动端口 可直接驱动静态 VFD 该电路由
一个 36 位串入并出/串入串出移位寄存器 一个 36 位数据控制驱动器两部分组成 带有级联端口 使
用时很灵活 根据用户的实际需要 CPU 编程控制非常方便 是 CPU 与静态 VFD 之间的非常理想的
元件
移位寄存器接收串行输入数据 输出串行数据 并提供送往控制驱动模块的并行数据 移位寄存
器有独立的时钟输入端 可通过复位信号对移位寄存器进行复位
功能特点
电路采用三电源供电 +5V GND 0V Vee -30V
高压驱动端口采用带有高压结构的开漏 PMOS 管输出 并带有下拉电阻
有很好的 CPU 接口 如 Din Ctl Reset
带有串行输出端口 串行输出电流大 可以根据需要采用级联
封装形式 QFP44
可直接驱动静态 VFD
管脚排列图
Out23
Out22
Out21
Out20
Out19
VDD
Out18
Out17
Out16
Out15
Out14
44 43 42 41 40 39 38 37 36 35 34
1 33
2 32
3 31
4 30
5 29
6
STF16360EN
28
7 27
8 26
9 25
10 24
11 23
12 13 14 15 16 17 18 19 20 21 22
Out35
Out36
SER
VSS
CTL
CLK
RST
DIN
VEE
Out1
Out2
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ETC STF16360EN
STF16360
管脚说明
管脚号
28
26
符号
CLk
Din
管脚名
输入时钟
串行数据输入端
29 CTL(En) 数据输出控制端
32-44
1-
-24
6
25
31
27
30
Out36-Out1
VDD
VEE
Dout
Reset
GND
功能框图
并行数据输出
逻辑电源
VFD 驱动高压
串行数据输出
清零信号
逻辑地
I/O 描述
I
下降沿时输入串行数据 上升沿时输出串
行数据
I 时钟下降沿时输入串行数据
低电平有效 允许并行数据输出 低电平
宽度不超过一个时钟周期 其下降沿要在
I 时钟上升沿之后 上升沿要在时钟下降沿
之前 使用中通过控制 En 有效信号输入
时间及扩展使用来实现多种并行输出
O CTL为低电压时 并行数据输出
5V
I 电压值可达-30V
O 时钟上升沿时输出串行数据
I 内接上拉电阻 低电平有效
与系统地相连
Din
CLk
Reset
36位移位
寄存器
36
显示控
制电路
36
高压驱
动电路
Out1
~
Out36
Dout
VDD
(+5V)
CTL GND VEE
(0V) (-30V)
功能说明
系统工作时 的复位功能可以通过多种形式完成
通过 CPU 直接从 Reset 端口加入复位
信号 也可在 Reset 端口与 GND 之间外接一个 20pF 的电容完成上电复位功能 也可通过 Din 端口采
用加零办法完成复位
STF16360共有两种模式 数据传输模式 显示驱动模式 工作中 两种模式交替进行 在数据传
输模式中 串行数据 Din 在时钟 CLk 控制下移位进入STF16360 并锁存 此时使能信号 En要设为高
电平 显示驱动模式中 En设为低电平 移位寄存器中的数据通过高压驱动模块直接输出 驱动 VFD
此时时钟信号要保持不变 串行输出端口 Dout 只受 CLk 控制 不受 En的控制 工作中可通过 CPU
EnCLk 之间时序的控制来选择芯片级联数 高压驱动端口数
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ETC STF16360EN
I/O 端口结构
1 输入端口 Din CLk CTL
VDD
STF16360
PMOS
VDD
14.4/2.0
NMOS
NMOS
2 输入端口 Reset
VDD
VDD
VDD
PMOS
PMOS
PMOS
NMOS
NMOS
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